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MIPI C-PHY提供高吞吐量、较少数量的互连信号和卓越的电源效率，可将显示器和相机连接到应用处理器。这是由于 C-PHY 独有的高效三相编码。这种设计较大限度地降低了系统互连的成本，也较大限度地减少了对通常与多媒体接口共处一地的敏感 RF 接收器电路的辐射。

C-PHY 为 MIPI 相机串行接口 2 ( MIPI CSI- 2) 和 MIPI 显示接口 2 ( MIPI DSI-2 ) 生态系统提供了一个物理层，使设计人员能够扩展他们的实现以支持各种更高分辨率图像传感器和显示器，同时保持低功耗。该规范可用于连接低成本、低分辨率的图像传感器，以及提供高达 60 兆像素的高性能传感器和提供 8K 和更高分辨率的显示面板。C-PHY 可应用于许多用例和行业领域，包括移动、可穿戴技术、物联网、无人机、个人计算机和汽车。

MIPI C-PHY 是一种嵌入式时钟链路，可为重新分配链路内的通道提供很大的灵活性。它还提供高速和低功耗模式之间的低延迟转换。MIPI C-PHY 通过摆脱传统的两线通道差分信号技术，引入大约 2.28 位/符号的三相符号编码来实现这一点，以在三线通道或“三重奏”上传输数据符号，其中每个三重奏包括一个嵌入式时钟。该规范在标准信道上支持高达 6 Gigasymbols (Gsps) 的符号率，相当于 13.7 Gbps，在短信道上支持高达 8 Gsps。三个以 6 Gsps 运行的三重奏通过九线接口实现了大约 41 吉比特每秒 (Gbps) 的峰值数据速率。

新版本的 MIPI C-PHY 2.1 版引入了 64 位 PHY 协议接口 (PPI)，为物理接口和芯片核心逻辑之间的更宽总线提供选项，从而更好地支持更高性能的应用程序。C-PHY v2.1 与之前版本的 C-PHY 完全兼容。

MIPI C-PHY 可以与MIPI D-PHY 共存于同一器件引脚上，因此设计人员可以开发双模器件。链路的运行数据速率可能是不对称的，这使实施者能够根据系统需求优化传输速率，并且还可以仅使用 C-PHY 的高速信号级别来实现链路运行。双向和半双工操作是可选的。

MIPI C-PHY 包括快速总线周转 (BTA) 以及备用低功耗 (ALP) 功能，该功能可仅使用 C-PHY 的高速信号电平实现链接操作。这些功能不仅支持移动设备的应用，还支持高速运行数米的物联网设备。此外，这些功能还支持 MIPI CSI-2 v3.0 统一串行链路 (USL) 支持的可选带内控制机制。

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来源：芯启示